IP -核心 FPGA & ASIC

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TicoRAW 是新的RAW !

intoPIX TicoRAW 是一种革命性的RAW (拜尔)图像处理和压缩技术,极其微小的和低功率r.


intoPIX 已经开发了各种架构,以不同的像素/时钟运行,针对广泛的像素率/帧率/图像传感器分辨率和广泛的FPGA 设备和ASIC 技术节点。 编码或解码可以在小型的AMD-Xilinx &Intel FPGA中实现,强大的实时操作,没有延迟。intoPIX 提供硅验证的IP ,在ASIC中门数和SRAM消耗非常低。


随着可用图像、图像传感器和视频分辨率的快速发展,对处理RAW/图像传感器数据的新方法的需求比以往任何时候都大。 


通过TicoRAW ,你可以捕捉、传输、存储、编辑、保存、分析、。RAW 拜尔数据 "更有效 "地使用小带宽和文件大小,保留了"RAW"的全部灵活性。


IP核的特点

TicoRAW IP-cores完全可用,并且经过硅验证,可用于FPGA 和ASIC 设计。

 图片/视频 
  •  色彩空间。(CFA-BAYER) - RGGB、RCCB等。
    • 可选的单色/灰度和4:2:2*模式
  • BIT DEPTH : 8, 10, 12, 14, 16
  • 分辨率。任何(2Mpx至160Mpx或更高)(见下面的例子,高清、2K、4K、8K、10K)。 
  • 像素率/帧率*:任意(取决于-核配置和目标设备)。
TicoRAW 处理和压缩
(延迟、质量、速率控制)
  • (子)帧内:降至0.1毫秒以内
  • 实时操作保证(无溢流或下溢) 
  • 固定延迟 - 只有几行像素(行数取决于配置文件)
  • 可调节的压缩率低至每像素1位的压缩率
  • 支持有损/视觉上无损/接近无损/数学上无损 
  • CBR(恒定比特率)操作(可选:恒定质量模式)。
  • 解码器内的ISP代理输出(解码器 IP-core Addon)
FPGA / ASIC 实现
  • 有多种每时钟像素架构可供选择,以实现对芯片的最小占用。
  •  在任何FPGA中实现低成本:非常低 FPGA 逻辑和内部 RAM 使用(无需外部 DDR)
    • 适合在Xilinx (AMD) Spartan-6, Artix-7, Kintex-7, Kintex Ultrascale, Zynq, Virtex Ultrascale, UltrascalePlus, Versal
    • 适用于Intel Cyclone V, Arria V, Stratix V, Cyclone 10, Arria 10, Stratix 10, Agilex
    • 适合在格子里 
  • ASIC 的低门区(低门数/低内存)--硅验证
  • 编码器和解码器的复杂性大致相同 
  • IP-核心可按应用定制 

*在422中,帧率将是在RAW Bayer模式下实现的帧率的一半。

新 - 高清,4K,8K,10K,16K,20KRAW ...
和你的配置为FPGA &ASIC

基于我们支持的所有功能,可以提供自定义版本,以满足您的特定需求。 

联系我们了解您自己的配置。 


S以下是一个典型的配置列表。最大帧数将取决于所选择的编码器/解码器及其相关的像素-每时钟结构。


IP-CORES
-ENC / -DEC
 颜色采样
传感器
Bit depth
决议的例子
最大帧数
在100MHz时*
最大帧数
在250MHz时*
最大帧数
 在300兆赫*时
最大帧数
在1GHz时*
IPX-TicoRAW-2K
(最大宽度为2048像素)
 RAW CFA Bayer  8, 10, 12, 14, 16
 2048 x 1080
2048 x 2048
 670
354
  839
442
 1006
530
  3354
1769
IPX-TicoRAW-4K
(最大宽度为4096像素)
RAW CFA Bayer 8, 10, 12, 14, 16
 4096 x 2160
4096 x 4096
 168
88
 209
110
 250
132
 837
441
IPX-TicoRAW-8K
(最大宽度为8192像素)
RAW CFA Bayer
 8, 10, 12, 14, 16
8192 x 4320
8192 x 8192
44
22
105
55
124
68
418
220
...
要求提供您的配置 

 *IP-cores的最大频率(MHz)可以根据你所选择的像素-每时钟架构和你的目标FPGA 或ASIC 技术节点来调整。

联系我们,了解更多关于我们的信息TicoRAW

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